drm/radeon/cik: write gfx ucode version to ucode addr reg
Helpful for debugging as the version shows up in a register dump. Cc: Jay Cornwall <jay.cornwall@amd.com> Signed-off-by: Alex Deucher <alexander.deucher@amd.com>
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commit
38aea07167
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@ -4235,7 +4235,7 @@ static int cik_cp_gfx_load_microcode(struct radeon_device *rdev)
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WREG32(CP_PFP_UCODE_ADDR, 0);
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for (i = 0; i < fw_size; i++)
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WREG32(CP_PFP_UCODE_DATA, le32_to_cpup(fw_data++));
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WREG32(CP_PFP_UCODE_ADDR, 0);
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WREG32(CP_PFP_UCODE_ADDR, le32_to_cpu(pfp_hdr->header.ucode_version));
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/* CE */
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fw_data = (const __le32 *)
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@ -4244,7 +4244,7 @@ static int cik_cp_gfx_load_microcode(struct radeon_device *rdev)
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WREG32(CP_CE_UCODE_ADDR, 0);
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for (i = 0; i < fw_size; i++)
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WREG32(CP_CE_UCODE_DATA, le32_to_cpup(fw_data++));
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WREG32(CP_CE_UCODE_ADDR, 0);
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WREG32(CP_CE_UCODE_ADDR, le32_to_cpu(ce_hdr->header.ucode_version));
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/* ME */
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fw_data = (const __be32 *)
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@ -4253,7 +4253,8 @@ static int cik_cp_gfx_load_microcode(struct radeon_device *rdev)
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WREG32(CP_ME_RAM_WADDR, 0);
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for (i = 0; i < fw_size; i++)
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WREG32(CP_ME_RAM_DATA, le32_to_cpup(fw_data++));
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WREG32(CP_ME_RAM_WADDR, 0);
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WREG32(CP_ME_RAM_WADDR, le32_to_cpu(me_hdr->header.ucode_version));
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WREG32(CP_ME_RAM_RADDR, le32_to_cpu(me_hdr->header.ucode_version));
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} else {
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const __be32 *fw_data;
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@ -4279,10 +4280,6 @@ static int cik_cp_gfx_load_microcode(struct radeon_device *rdev)
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WREG32(CP_ME_RAM_WADDR, 0);
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}
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WREG32(CP_PFP_UCODE_ADDR, 0);
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WREG32(CP_CE_UCODE_ADDR, 0);
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WREG32(CP_ME_RAM_WADDR, 0);
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WREG32(CP_ME_RAM_RADDR, 0);
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return 0;
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}
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@ -4564,7 +4561,7 @@ static int cik_cp_compute_load_microcode(struct radeon_device *rdev)
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WREG32(CP_MEC_ME1_UCODE_ADDR, 0);
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for (i = 0; i < fw_size; i++)
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WREG32(CP_MEC_ME1_UCODE_DATA, le32_to_cpup(fw_data++));
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WREG32(CP_MEC_ME1_UCODE_ADDR, 0);
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WREG32(CP_MEC_ME1_UCODE_ADDR, le32_to_cpu(mec_hdr->header.ucode_version));
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/* MEC2 */
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if (rdev->family == CHIP_KAVERI) {
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@ -4578,7 +4575,7 @@ static int cik_cp_compute_load_microcode(struct radeon_device *rdev)
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WREG32(CP_MEC_ME2_UCODE_ADDR, 0);
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for (i = 0; i < fw_size; i++)
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WREG32(CP_MEC_ME2_UCODE_DATA, le32_to_cpup(fw_data++));
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WREG32(CP_MEC_ME2_UCODE_ADDR, 0);
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WREG32(CP_MEC_ME2_UCODE_ADDR, le32_to_cpu(mec2_hdr->header.ucode_version));
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}
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} else {
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const __be32 *fw_data;
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@ -6227,7 +6224,7 @@ static int cik_rlc_resume(struct radeon_device *rdev)
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WREG32(RLC_GPM_UCODE_ADDR, 0);
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for (i = 0; i < size; i++)
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WREG32(RLC_GPM_UCODE_DATA, le32_to_cpup(fw_data++));
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WREG32(RLC_GPM_UCODE_ADDR, 0);
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WREG32(RLC_GPM_UCODE_ADDR, le32_to_cpu(hdr->header.ucode_version));
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} else {
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const __be32 *fw_data;
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