ARM: S3C64XX: add support for all group 0 external interrupts
Signed-off-by: Maurus Cuelenaere <mcuelenaere@gmail.com> Signed-off-by: Ben Dooks <ben-linux@fluff.org>
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6a88e9838f
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@ -213,6 +213,11 @@ static struct s3c_gpio_cfg gpio_4bit_cfg_eint0011 = {
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.get_pull = s3c_gpio_getpull_updown,
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};
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int s3c64xx_gpio2int_gpm(struct gpio_chip *chip, unsigned pin)
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{
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return pin < 5 ? IRQ_EINT(23) + pin : -ENXIO;
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}
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static struct s3c_gpio_chip gpio_4bit[] = {
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{
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.base = S3C64XX_GPA_BASE,
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@ -269,10 +274,16 @@ static struct s3c_gpio_chip gpio_4bit[] = {
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.base = S3C64XX_GPM(0),
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.ngpio = S3C64XX_GPIO_M_NR,
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.label = "GPM",
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.to_irq = s3c64xx_gpio2int_gpm,
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},
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},
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};
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int s3c64xx_gpio2int_gpl(struct gpio_chip *chip, unsigned pin)
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{
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return pin >= 8 ? IRQ_EINT(16) + pin - 8 : -ENXIO;
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}
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static struct s3c_gpio_chip gpio_4bit2[] = {
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{
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.base = S3C64XX_GPH_BASE + 0x4,
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@ -297,6 +308,7 @@ static struct s3c_gpio_chip gpio_4bit2[] = {
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|||
.base = S3C64XX_GPL(0),
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||||
.ngpio = S3C64XX_GPIO_L_NR,
|
||||
.label = "GPL",
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||||
.to_irq = s3c64xx_gpio2int_gpl,
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},
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},
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};
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@ -65,7 +65,7 @@ static void s3c_irq_eint_maskack(unsigned int irq)
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static int s3c_irq_eint_set_type(unsigned int irq, unsigned int type)
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{
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int offs = eint_offset(irq);
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int pin;
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int pin, pin_val;
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int shift;
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u32 ctrl, mask;
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u32 newvalue = 0;
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@ -109,7 +109,10 @@ static int s3c_irq_eint_set_type(unsigned int irq, unsigned int type)
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return -1;
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}
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shift = (offs / 2) * 4;
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if (offs <= 15)
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shift = (offs / 2) * 4;
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else
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shift = ((offs - 16) / 2) * 4;
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mask = 0x7 << shift;
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ctrl = __raw_readl(reg);
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@ -119,12 +122,18 @@ static int s3c_irq_eint_set_type(unsigned int irq, unsigned int type)
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/* set the GPIO pin appropriately */
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if (offs < 23)
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if (offs < 16) {
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pin = S3C64XX_GPN(offs);
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else
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pin_val = S3C_GPIO_SFN(2);
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} else if (offs < 23) {
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pin = S3C64XX_GPL(offs + 8 - 16);
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||||
pin_val = S3C_GPIO_SFN(3);
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} else {
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pin = S3C64XX_GPM(offs - 23);
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||||
pin_val = S3C_GPIO_SFN(3);
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}
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s3c_gpio_cfgpin(pin, S3C_GPIO_SFN(2));
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s3c_gpio_cfgpin(pin, pin_val);
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return 0;
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}
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