EDAC, MCE: Adjust DC decoders to F14h
Add a per-family data cache decoders. Since there is a certain overlap between the different DC MCE signatures, reuse functionality between the families as far as possible. Signed-off-by: Borislav Petkov <borislav.petkov@amd.com>hifive-unleashed-5.1
Borislav Petkov
Borislav Petkov
parent
47ca08a40b
commit
888ab8e6eb
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@ -1,6 +1,10 @@
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#include <linux/module.h>
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#include <linux/slab.h>
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#include "mce_amd.h"
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static struct amd_decoder_ops *fam_ops;
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static bool report_gart_errors;
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static void (*nb_bus_decoder)(int node_id, struct mce *m, u32 nbcfg);
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@ -97,41 +101,116 @@ const char *ext_msgs[] = {
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};
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EXPORT_SYMBOL_GPL(ext_msgs);
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static bool f10h_dc_mce(u16 ec)
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{
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u8 r4 = (ec >> 4) & 0xf;
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bool ret = false;
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if (r4 == R4_GEN) {
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pr_cont("during data scrub.\n");
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return true;
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}
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if (MEM_ERROR(ec)) {
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u8 ll = ec & 0x3;
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ret = true;
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if (ll == LL_L2)
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pr_cont("during L1 linefill from L2.\n");
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else if (ll == LL_L1)
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pr_cont("Data/Tag %s error.\n", RRRR_MSG(ec));
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||||
else
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ret = false;
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}
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return ret;
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}
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static bool k8_dc_mce(u16 ec)
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{
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if (BUS_ERROR(ec)) {
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pr_cont("during system linefill.\n");
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return true;
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}
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||||
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return f10h_dc_mce(ec);
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||||
}
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static bool f14h_dc_mce(u16 ec)
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||||
{
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u8 r4 = (ec >> 4) & 0xf;
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u8 ll = ec & 0x3;
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u8 tt = (ec >> 2) & 0x3;
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u8 ii = tt;
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bool ret = true;
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if (MEM_ERROR(ec)) {
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if (tt != TT_DATA || ll != LL_L1)
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return false;
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switch (r4) {
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case R4_DRD:
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||||
case R4_DWR:
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pr_cont("Data/Tag parity error due to %s.\n",
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||||
(r4 == R4_DRD ? "load/hw prf" : "store"));
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break;
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||||
case R4_EVICT:
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pr_cont("Copyback parity error on a tag miss.\n");
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||||
break;
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||||
case R4_SNOOP:
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pr_cont("Tag parity error during snoop.\n");
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||||
break;
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default:
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ret = false;
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}
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||||
} else if (BUS_ERROR(ec)) {
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if ((ii != II_MEM && ii != II_IO) || ll != LL_LG)
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return false;
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pr_cont("System read data error on a ");
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switch (r4) {
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case R4_RD:
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pr_cont("TLB reload.\n");
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||||
break;
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||||
case R4_DWR:
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||||
pr_cont("store.\n");
|
||||
break;
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||||
case R4_DRD:
|
||||
pr_cont("load.\n");
|
||||
break;
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||||
default:
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||||
ret = false;
|
||||
}
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||||
} else {
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||||
ret = false;
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||||
}
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||||
return ret;
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||||
}
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static void amd_decode_dc_mce(struct mce *m)
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{
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u32 ec = m->status & 0xffff;
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||||
u32 xec = (m->status >> 16) & 0xf;
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||||
u16 ec = m->status & 0xffff;
|
||||
u8 xec = (m->status >> 16) & 0xf;
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pr_emerg(HW_ERR "Data Cache Error: ");
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||||
if (xec == 1 && TLB_ERROR(ec))
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pr_cont(": %s TLB multimatch.\n", LL_MSG(ec));
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else if (xec == 0) {
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||||
if (m->status & (1ULL << 40))
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||||
pr_cont(" during Data Scrub.\n");
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||||
else if (TLB_ERROR(ec))
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||||
pr_cont(": %s TLB parity error.\n", LL_MSG(ec));
|
||||
else if (MEM_ERROR(ec)) {
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||||
u8 ll = ec & 0x3;
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||||
u8 tt = (ec >> 2) & 0x3;
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||||
u8 rrrr = (ec >> 4) & 0xf;
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||||
/* TLB error signatures are the same across families */
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||||
if (TLB_ERROR(ec)) {
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||||
u8 tt = (ec >> 2) & 0x3;
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||||
/* see F10h BKDG (31116), Table 92. */
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||||
if (ll == 0x1) {
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||||
if (tt != 0x1)
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||||
goto wrong_dc_mce;
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||||
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||||
pr_cont(": Data/Tag %s error.\n", RRRR_MSG(ec));
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||||
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||||
} else if (ll == 0x2 && rrrr == 0x3)
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||||
pr_cont(" during L1 linefill from L2.\n");
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||||
else
|
||||
goto wrong_dc_mce;
|
||||
} else if (BUS_ERROR(ec) && boot_cpu_data.x86 == 0xf)
|
||||
pr_cont(" during system linefill.\n");
|
||||
if (tt == TT_DATA) {
|
||||
pr_cont("%s TLB %s.\n", LL_MSG(ec),
|
||||
(xec ? "multimatch" : "parity error"));
|
||||
return;
|
||||
}
|
||||
else
|
||||
goto wrong_dc_mce;
|
||||
} else
|
||||
}
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||||
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||||
if (!fam_ops->dc_mce(ec))
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||||
goto wrong_dc_mce;
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||||
return;
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@ -395,6 +474,30 @@ static int __init mce_amd_init(void)
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if (boot_cpu_data.x86 < 0xf || boot_cpu_data.x86 > 0x11)
|
||||
return 0;
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fam_ops = kzalloc(sizeof(struct amd_decoder_ops), GFP_KERNEL);
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||||
if (!fam_ops)
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||||
return -ENOMEM;
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||||
switch (boot_cpu_data.x86) {
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||||
case 0xf:
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||||
fam_ops->dc_mce = k8_dc_mce;
|
||||
break;
|
||||
|
||||
case 0x10:
|
||||
fam_ops->dc_mce = f10h_dc_mce;
|
||||
break;
|
||||
|
||||
case 0x14:
|
||||
fam_ops->dc_mce = f14h_dc_mce;
|
||||
break;
|
||||
|
||||
default:
|
||||
printk(KERN_WARNING "Huh? What family is that: %d?!\n",
|
||||
boot_cpu_data.x86);
|
||||
kfree(fam_ops);
|
||||
return -EINVAL;
|
||||
}
|
||||
|
||||
atomic_notifier_chain_register(&x86_mce_decoder_chain, &amd_mce_dec_nb);
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||||
return 0;
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@ -405,6 +508,7 @@ early_initcall(mce_amd_init);
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|||
static void __exit mce_amd_exit(void)
|
||||
{
|
||||
atomic_notifier_chain_unregister(&x86_mce_decoder_chain, &amd_mce_dec_nb);
|
||||
kfree(fam_ops);
|
||||
}
|
||||
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||||
MODULE_DESCRIPTION("AMD MCE decoder");
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||||
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@ -44,6 +44,39 @@
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#define K8_NBSH_UECC BIT(13)
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#define K8_NBSH_ERR_SCRUBER BIT(8)
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enum tt_ids {
|
||||
TT_INSTR = 0,
|
||||
TT_DATA,
|
||||
TT_GEN,
|
||||
TT_RESV,
|
||||
};
|
||||
|
||||
enum ll_ids {
|
||||
LL_RESV = 0,
|
||||
LL_L1,
|
||||
LL_L2,
|
||||
LL_LG,
|
||||
};
|
||||
|
||||
enum ii_ids {
|
||||
II_MEM = 0,
|
||||
II_RESV,
|
||||
II_IO,
|
||||
II_GEN,
|
||||
};
|
||||
|
||||
enum rrrr_ids {
|
||||
R4_GEN = 0,
|
||||
R4_RD,
|
||||
R4_WR,
|
||||
R4_DRD,
|
||||
R4_DWR,
|
||||
R4_IRD,
|
||||
R4_PREF,
|
||||
R4_EVICT,
|
||||
R4_SNOOP,
|
||||
};
|
||||
|
||||
extern const char *tt_msgs[];
|
||||
extern const char *ll_msgs[];
|
||||
extern const char *rrrr_msgs[];
|
||||
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@ -63,6 +96,13 @@ struct err_regs {
|
|||
u32 nbeal;
|
||||
};
|
||||
|
||||
/*
|
||||
* per-family decoder ops
|
||||
*/
|
||||
struct amd_decoder_ops {
|
||||
bool (*dc_mce)(u16);
|
||||
};
|
||||
|
||||
void amd_report_gart_errors(bool);
|
||||
void amd_register_ecc_decoder(void (*f)(int, struct mce *, u32));
|
||||
void amd_unregister_ecc_decoder(void (*f)(int, struct mce *, u32));
|
||||
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