drm/radeon/cik: add rlc helpers for DPM
Signed-off-by: Alex Deucher <alexander.deucher@amd.com>
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84a9d9eeab
commit
a412fce054
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@ -5587,6 +5587,35 @@ static u32 cik_halt_rlc(struct radeon_device *rdev)
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return orig;
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return orig;
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}
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}
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void cik_enter_rlc_safe_mode(struct radeon_device *rdev)
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{
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u32 tmp, i, mask;
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tmp = REQ | MESSAGE(MSG_ENTER_RLC_SAFE_MODE);
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WREG32(RLC_GPR_REG2, tmp);
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mask = GFX_POWER_STATUS | GFX_CLOCK_STATUS;
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for (i = 0; i < rdev->usec_timeout; i++) {
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if ((RREG32(RLC_GPM_STAT) & mask) == mask)
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break;
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udelay(1);
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}
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for (i = 0; i < rdev->usec_timeout; i++) {
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if ((RREG32(RLC_GPR_REG2) & REQ) == 0)
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break;
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udelay(1);
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}
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}
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void cik_exit_rlc_safe_mode(struct radeon_device *rdev)
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{
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u32 tmp;
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tmp = REQ | MESSAGE(MSG_EXIT_RLC_SAFE_MODE);
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WREG32(RLC_GPR_REG2, tmp);
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}
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/**
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/**
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* cik_rlc_stop - stop the RLC ME
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* cik_rlc_stop - stop the RLC ME
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*
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*
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@ -952,6 +952,8 @@
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#define RLC_GPM_STAT 0xC400
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#define RLC_GPM_STAT 0xC400
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# define RLC_GPM_BUSY (1 << 0)
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# define RLC_GPM_BUSY (1 << 0)
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# define GFX_POWER_STATUS (1 << 1)
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# define GFX_CLOCK_STATUS (1 << 2)
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#define RLC_PG_CNTL 0xC40C
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#define RLC_PG_CNTL 0xC40C
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# define GFX_PG_ENABLE (1 << 0)
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# define GFX_PG_ENABLE (1 << 0)
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@ -1004,6 +1006,13 @@
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#define RLC_GPM_SCRATCH_ADDR 0xC4B0
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#define RLC_GPM_SCRATCH_ADDR 0xC4B0
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#define RLC_GPM_SCRATCH_DATA 0xC4B4
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#define RLC_GPM_SCRATCH_DATA 0xC4B4
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#define RLC_GPR_REG2 0xC4E8
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#define REQ 0x00000001
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#define MESSAGE(x) ((x) << 1)
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#define MESSAGE_MASK 0x0000001e
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#define MSG_ENTER_RLC_SAFE_MODE 1
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#define MSG_EXIT_RLC_SAFE_MODE 0
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#define CP_HPD_EOP_BASE_ADDR 0xC904
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#define CP_HPD_EOP_BASE_ADDR 0xC904
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#define CP_HPD_EOP_BASE_ADDR_HI 0xC908
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#define CP_HPD_EOP_BASE_ADDR_HI 0xC908
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#define CP_HPD_EOP_VMID 0xC90C
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#define CP_HPD_EOP_VMID 0xC90C
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