![Stephen Warren](/assets/img/avatar_default.png)
Tegra186 contains two separate but mostly similar GPIO controllers. Register layout differs significantly from previous Tegra generations, and so a new binding is required to describe them in device tree. This patch adds that binding. Signed-off-by: Stephen Warren <swarren@nvidia.com> Acked-by: Rob Herring <robh@kernel.org> Acked-by: Linus Walleij <linus.walleij@linaro.org> Signed-off-by: Thierry Reding <treding@nvidia.com>
57 lines
1.6 KiB
C
57 lines
1.6 KiB
C
/*
|
|
* This header provides constants for binding nvidia,tegra186-gpio*.
|
|
*
|
|
* The first cell in Tegra's GPIO specifier is the GPIO ID. The macros below
|
|
* provide names for this.
|
|
*
|
|
* The second cell contains standard flag values specified in gpio.h.
|
|
*/
|
|
|
|
#ifndef _DT_BINDINGS_GPIO_TEGRA_GPIO_H
|
|
#define _DT_BINDINGS_GPIO_TEGRA_GPIO_H
|
|
|
|
#include <dt-bindings/gpio/gpio.h>
|
|
|
|
/* GPIOs implemented by main GPIO controller */
|
|
#define TEGRA_MAIN_GPIO_PORT_A 0
|
|
#define TEGRA_MAIN_GPIO_PORT_B 1
|
|
#define TEGRA_MAIN_GPIO_PORT_C 2
|
|
#define TEGRA_MAIN_GPIO_PORT_D 3
|
|
#define TEGRA_MAIN_GPIO_PORT_E 4
|
|
#define TEGRA_MAIN_GPIO_PORT_F 5
|
|
#define TEGRA_MAIN_GPIO_PORT_G 6
|
|
#define TEGRA_MAIN_GPIO_PORT_H 7
|
|
#define TEGRA_MAIN_GPIO_PORT_I 8
|
|
#define TEGRA_MAIN_GPIO_PORT_J 9
|
|
#define TEGRA_MAIN_GPIO_PORT_K 10
|
|
#define TEGRA_MAIN_GPIO_PORT_L 11
|
|
#define TEGRA_MAIN_GPIO_PORT_M 12
|
|
#define TEGRA_MAIN_GPIO_PORT_N 13
|
|
#define TEGRA_MAIN_GPIO_PORT_O 14
|
|
#define TEGRA_MAIN_GPIO_PORT_P 15
|
|
#define TEGRA_MAIN_GPIO_PORT_Q 16
|
|
#define TEGRA_MAIN_GPIO_PORT_R 17
|
|
#define TEGRA_MAIN_GPIO_PORT_T 18
|
|
#define TEGRA_MAIN_GPIO_PORT_X 19
|
|
#define TEGRA_MAIN_GPIO_PORT_Y 20
|
|
#define TEGRA_MAIN_GPIO_PORT_BB 21
|
|
#define TEGRA_MAIN_GPIO_PORT_CC 22
|
|
|
|
#define TEGRA_MAIN_GPIO(port, offset) \
|
|
((TEGRA_MAIN_GPIO_PORT_##port * 8) + offset)
|
|
|
|
/* GPIOs implemented by AON GPIO controller */
|
|
#define TEGRA_AON_GPIO_PORT_S 0
|
|
#define TEGRA_AON_GPIO_PORT_U 1
|
|
#define TEGRA_AON_GPIO_PORT_V 2
|
|
#define TEGRA_AON_GPIO_PORT_W 3
|
|
#define TEGRA_AON_GPIO_PORT_Z 4
|
|
#define TEGRA_AON_GPIO_PORT_AA 5
|
|
#define TEGRA_AON_GPIO_PORT_EE 6
|
|
#define TEGRA_AON_GPIO_PORT_FF 7
|
|
|
|
#define TEGRA_AON_GPIO(port, offset) \
|
|
((TEGRA_AON_GPIO_PORT_##port * 8) + offset)
|
|
|
|
#endif
|