gpio/omap: replace get_gpio_index() by using bank width
The get_gpio_index() function, littered with cpu_is_* checks can be easily replaced by using bitops based on the GPIO bank width. Do so. Signed-off-by: Kevin Hilman <khilman@ti.com>
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c390aad033
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129fd22307
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@ -83,6 +83,9 @@ static struct gpio_bank *gpio_bank;
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/* TODO: Analyze removing gpio_bank_count usage from driver code */
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int gpio_bank_count;
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#define GPIO_INDEX(bank, gpio) (gpio % bank->width)
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#define GPIO_BIT(bank, gpio) (1 << GPIO_INDEX(bank, gpio))
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static inline struct gpio_bank *get_gpio_bank(int gpio)
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{
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if (cpu_is_omap15xx()) {
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@ -108,17 +111,6 @@ static inline struct gpio_bank *get_gpio_bank(int gpio)
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return NULL;
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}
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static inline int get_gpio_index(int gpio)
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{
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if (cpu_is_omap7xx())
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return gpio & 0x1f;
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if (cpu_is_omap24xx())
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return gpio & 0x1f;
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if (cpu_is_omap34xx() || cpu_is_omap44xx())
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return gpio & 0x1f;
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return gpio & 0x0f;
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}
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static inline int gpio_valid(int gpio)
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{
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if (gpio < 0)
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@ -313,7 +305,7 @@ static int _get_gpio_datain(struct gpio_bank *bank, int gpio)
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return -EINVAL;
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}
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return (__raw_readl(reg)
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& (1 << get_gpio_index(gpio))) != 0;
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& (GPIO_BIT(bank, gpio))) != 0;
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}
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static int _get_gpio_dataout(struct gpio_bank *bank, int gpio)
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@ -359,7 +351,7 @@ static int _get_gpio_dataout(struct gpio_bank *bank, int gpio)
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return -EINVAL;
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}
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return (__raw_readl(reg) & (1 << get_gpio_index(gpio))) != 0;
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return (__raw_readl(reg) & GPIO_BIT(bank, gpio)) != 0;
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}
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#define MOD_REG_BIT(reg, bit_mask, set) \
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@ -396,7 +388,7 @@ static void _set_gpio_debounce(struct gpio_bank *bank, unsigned gpio,
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else
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debounce = (debounce / 0x1f) - 1;
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l = 1 << get_gpio_index(gpio);
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l = GPIO_BIT(bank, gpio);
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if (bank->method == METHOD_GPIO_44XX)
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reg += OMAP4_GPIO_DEBOUNCINGTIME;
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@ -640,7 +632,7 @@ static int gpio_irq_type(struct irq_data *d, unsigned type)
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bank = irq_data_get_irq_chip_data(d);
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spin_lock_irqsave(&bank->lock, flags);
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retval = _set_gpio_triggering(bank, get_gpio_index(gpio), type);
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retval = _set_gpio_triggering(bank, GPIO_INDEX(bank, gpio), type);
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spin_unlock_irqrestore(&bank->lock, flags);
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if (type & (IRQ_TYPE_LEVEL_LOW | IRQ_TYPE_LEVEL_HIGH))
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@ -702,7 +694,7 @@ static void _clear_gpio_irqbank(struct gpio_bank *bank, int gpio_mask)
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static inline void _clear_gpio_irqstatus(struct gpio_bank *bank, int gpio)
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{
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_clear_gpio_irqbank(bank, 1 << get_gpio_index(gpio));
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_clear_gpio_irqbank(bank, GPIO_BIT(bank, gpio));
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}
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static u32 _get_gpio_irqbank_mask(struct gpio_bank *bank)
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@ -830,7 +822,7 @@ static void _enable_gpio_irqbank(struct gpio_bank *bank, int gpio_mask, int enab
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static inline void _set_gpio_irqenable(struct gpio_bank *bank, int gpio, int enable)
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{
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_enable_gpio_irqbank(bank, 1 << get_gpio_index(gpio), enable);
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_enable_gpio_irqbank(bank, GPIO_BIT(bank, gpio), enable);
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}
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/*
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@ -883,10 +875,10 @@ static int _set_gpio_wakeup(struct gpio_bank *bank, int gpio, int enable)
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static void _reset_gpio(struct gpio_bank *bank, int gpio)
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{
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_set_gpio_direction(bank, get_gpio_index(gpio), 1);
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_set_gpio_direction(bank, GPIO_INDEX(bank, gpio), 1);
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||||
_set_gpio_irqenable(bank, gpio, 0);
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||||
_clear_gpio_irqstatus(bank, gpio);
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||||
_set_gpio_triggering(bank, get_gpio_index(gpio), IRQ_TYPE_NONE);
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||||
_set_gpio_triggering(bank, GPIO_INDEX(bank, gpio), IRQ_TYPE_NONE);
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}
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/* Use disable_irq_wake() and enable_irq_wake() functions from drivers */
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@ -899,7 +891,7 @@ static int gpio_wake_enable(struct irq_data *d, unsigned int enable)
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if (check_gpio(gpio) < 0)
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return -ENODEV;
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bank = irq_data_get_irq_chip_data(d);
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||||
retval = _set_gpio_wakeup(bank, get_gpio_index(gpio), enable);
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||||
retval = _set_gpio_wakeup(bank, GPIO_INDEX(bank, gpio), enable);
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||||
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||||
return retval;
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||||
}
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@ -1079,7 +1071,7 @@ static void gpio_irq_handler(unsigned int irq, struct irq_desc *desc)
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gpio_irq = bank->virtual_irq_start;
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for (; isr != 0; isr >>= 1, gpio_irq++) {
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gpio_index = get_gpio_index(irq_to_gpio(gpio_irq));
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gpio_index = GPIO_INDEX(bank, irq_to_gpio(gpio_irq));
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||||
if (!(isr & 1))
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||||
continue;
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@ -1135,7 +1127,7 @@ static void gpio_mask_irq(struct irq_data *d)
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spin_lock_irqsave(&bank->lock, flags);
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_set_gpio_irqenable(bank, gpio, 0);
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||||
_set_gpio_triggering(bank, get_gpio_index(gpio), IRQ_TYPE_NONE);
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||||
_set_gpio_triggering(bank, GPIO_INDEX(bank, gpio), IRQ_TYPE_NONE);
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||||
spin_unlock_irqrestore(&bank->lock, flags);
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}
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@ -1143,13 +1135,13 @@ static void gpio_unmask_irq(struct irq_data *d)
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{
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unsigned int gpio = d->irq - IH_GPIO_BASE;
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struct gpio_bank *bank = irq_data_get_irq_chip_data(d);
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unsigned int irq_mask = 1 << get_gpio_index(gpio);
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unsigned int irq_mask = GPIO_BIT(bank, gpio);
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u32 trigger = irqd_get_trigger_type(d);
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unsigned long flags;
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||||
spin_lock_irqsave(&bank->lock, flags);
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if (trigger)
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_set_gpio_triggering(bank, get_gpio_index(gpio), trigger);
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||||
_set_gpio_triggering(bank, GPIO_INDEX(bank, gpio), trigger);
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||||
/* For level-triggered GPIOs, the clearing must be done after
|
||||
* the HW source is cleared, thus after the handler has run */
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@ -1352,7 +1344,7 @@ static int gpio_get(struct gpio_chip *chip, unsigned offset)
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gpio = chip->base + offset;
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bank = get_gpio_bank(gpio);
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reg = bank->base;
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mask = 1 << get_gpio_index(gpio);
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mask = GPIO_BIT(bank, gpio);
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if (gpio_is_input(bank, mask))
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return _get_gpio_datain(bank, gpio);
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