PCMCIA: sa11x0: nanoengine: convert reset handling to use GPIO subsystem
Rather than accessing GPSR and GPCR directly, use the GPIO subsystem instead. Acked-by: Dominik Brodowski <linux@dominikbrodowski.net> Signed-off-by: Russell King <rmk+kernel@arm.linux.org.uk>
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76346a4eab
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@ -20,8 +20,8 @@
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#define GPIO_PC_READY1 12 /* ready for socket 1 (active high) */
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#define GPIO_PC_CD0 13 /* detect for socket 0 (active low) */
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#define GPIO_PC_CD1 14 /* detect for socket 1 (active low) */
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#define GPIO_PC_RESET0 GPIO_GPIO(15) /* reset socket 0 */
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#define GPIO_PC_RESET1 GPIO_GPIO(16) /* reset socket 1 */
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#define GPIO_PC_RESET0 15 /* reset socket 0 */
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#define GPIO_PC_RESET1 16 /* reset socket 1 */
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#define NANOENGINE_IRQ_GPIO_PCI IRQ_GPIO0
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#define NANOENGINE_IRQ_GPIO_PC_READY0 IRQ_GPIO11
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@ -19,6 +19,7 @@
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*/
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#include <linux/device.h>
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#include <linux/errno.h>
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#include <linux/gpio.h>
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#include <linux/interrupt.h>
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#include <linux/irq.h>
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#include <linux/init.h>
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@ -37,19 +38,18 @@
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struct nanoengine_pins {
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unsigned output_pins;
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unsigned clear_outputs;
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int gpio_rst;
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int gpio_cd;
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int gpio_rdy;
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};
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static struct nanoengine_pins nano_skts[] = {
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{
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.output_pins = GPIO_PC_RESET0,
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.clear_outputs = GPIO_PC_RESET0,
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||||
.gpio_rst = GPIO_PC_RESET0,
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.gpio_cd = GPIO_PC_CD0,
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||||
.gpio_rdy = GPIO_PC_READY0,
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}, {
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.output_pins = GPIO_PC_RESET1,
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||||
.clear_outputs = GPIO_PC_RESET1,
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||||
.gpio_rst = GPIO_PC_RESET1,
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||||
.gpio_cd = GPIO_PC_CD1,
|
||||
.gpio_rdy = GPIO_PC_READY1,
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||||
}
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@ -60,12 +60,15 @@ unsigned num_nano_pcmcia_sockets = ARRAY_SIZE(nano_skts);
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static int nanoengine_pcmcia_hw_init(struct soc_pcmcia_socket *skt)
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{
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unsigned i = skt->nr;
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int ret;
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if (i >= num_nano_pcmcia_sockets)
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return -ENXIO;
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GPDR |= nano_skts[i].output_pins;
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GPCR = nano_skts[i].clear_outputs;
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ret = gpio_request_one(nano_skts[i].gpio_rst, GPIOF_OUT_INIT_LOW,
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i ? "PC RST1" : "PC RST0");
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if (ret)
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return ret;
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skt->stat[SOC_STAT_CD].gpio = nano_skts[i].gpio_cd;
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skt->stat[SOC_STAT_CD].name = i ? "PC CD1" : "PC CD0";
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@ -75,30 +78,20 @@ static int nanoengine_pcmcia_hw_init(struct soc_pcmcia_socket *skt)
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return 0;
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}
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static void nanoengine_pcmcia_hw_shutdown(struct soc_pcmcia_socket *skt)
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{
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gpio_free(nano_skts[skt->nr].gpio_rst);
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}
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static int nanoengine_pcmcia_configure_socket(
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struct soc_pcmcia_socket *skt, const socket_state_t *state)
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{
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unsigned reset;
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unsigned i = skt->nr;
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||||
if (i >= num_nano_pcmcia_sockets)
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return -ENXIO;
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switch (i) {
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case 0:
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reset = GPIO_PC_RESET0;
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break;
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case 1:
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reset = GPIO_PC_RESET1;
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||||
break;
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default:
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return -ENXIO;
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}
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if (state->flags & SS_RESET)
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GPSR = reset;
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else
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GPCR = reset;
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gpio_set_value(nano_skts[skt->nr].gpio_rst, !!(state->flags & SS_RESET));
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return 0;
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}
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@ -122,6 +115,7 @@ static struct pcmcia_low_level nanoengine_pcmcia_ops = {
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.owner = THIS_MODULE,
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.hw_init = nanoengine_pcmcia_hw_init,
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.hw_shutdown = nanoengine_pcmcia_hw_shutdown,
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.configure_socket = nanoengine_pcmcia_configure_socket,
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||||
.socket_state = nanoengine_pcmcia_socket_state,
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