gpio/mxc: use the edge_sel feature if available
Some mxc processors have an edge_sel feature, which allows the IRQ to be triggered by any edge. This patch makes use of this feature if available, which skips mxc_flip_edge(). Cc: Grant Likely <grant.likely@secretlab.ca> Cc: Linus Walleij <linus.walleij@stericsson.com> Acked-by: Sascha Hauer <kernel@pengutronix.de> Cc: <linux-arm-kernel@lists.infradead.org> Signed-off-by: Benoît Thébaudeau <benoit.thebaudeau@advansee.com> Signed-off-by: Linus Walleij <linus.walleij@linaro.org>
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41920d1636
commit
aeb27748e3
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@ -14,7 +14,7 @@ Required properties:
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Example:
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Example:
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gpio0: gpio@73f84000 {
|
gpio0: gpio@73f84000 {
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compatible = "fsl,imx51-gpio", "fsl,imx31-gpio";
|
compatible = "fsl,imx51-gpio", "fsl,imx35-gpio";
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||||||
reg = <0x73f84000 0x4000>;
|
reg = <0x73f84000 0x4000>;
|
||||||
interrupts = <50 51>;
|
interrupts = <50 51>;
|
||||||
gpio-controller;
|
gpio-controller;
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||||||
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@ -127,7 +127,7 @@
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};
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};
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gpio1: gpio@73f84000 {
|
gpio1: gpio@73f84000 {
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||||||
compatible = "fsl,imx51-gpio", "fsl,imx31-gpio";
|
compatible = "fsl,imx51-gpio", "fsl,imx35-gpio";
|
||||||
reg = <0x73f84000 0x4000>;
|
reg = <0x73f84000 0x4000>;
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interrupts = <50 51>;
|
interrupts = <50 51>;
|
||||||
gpio-controller;
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gpio-controller;
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||||||
|
@ -137,7 +137,7 @@
|
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};
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};
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||||||
gpio2: gpio@73f88000 {
|
gpio2: gpio@73f88000 {
|
||||||
compatible = "fsl,imx51-gpio", "fsl,imx31-gpio";
|
compatible = "fsl,imx51-gpio", "fsl,imx35-gpio";
|
||||||
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|
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interrupts = <52 53>;
|
interrupts = <52 53>;
|
||||||
gpio-controller;
|
gpio-controller;
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||||||
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@ -147,7 +147,7 @@
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};
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};
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gpio3: gpio@73f8c000 {
|
gpio3: gpio@73f8c000 {
|
||||||
compatible = "fsl,imx51-gpio", "fsl,imx31-gpio";
|
compatible = "fsl,imx51-gpio", "fsl,imx35-gpio";
|
||||||
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|
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|
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interrupts = <54 55>;
|
interrupts = <54 55>;
|
||||||
gpio-controller;
|
gpio-controller;
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||||||
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@ -157,7 +157,7 @@
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};
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};
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gpio4: gpio@73f90000 {
|
gpio4: gpio@73f90000 {
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||||||
compatible = "fsl,imx51-gpio", "fsl,imx31-gpio";
|
compatible = "fsl,imx51-gpio", "fsl,imx35-gpio";
|
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|
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|
||||||
interrupts = <56 57>;
|
interrupts = <56 57>;
|
||||||
gpio-controller;
|
gpio-controller;
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||||||
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@ -129,7 +129,7 @@
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};
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};
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gpio1: gpio@53f84000 {
|
gpio1: gpio@53f84000 {
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||||||
compatible = "fsl,imx53-gpio", "fsl,imx31-gpio";
|
compatible = "fsl,imx53-gpio", "fsl,imx35-gpio";
|
||||||
reg = <0x53f84000 0x4000>;
|
reg = <0x53f84000 0x4000>;
|
||||||
interrupts = <50 51>;
|
interrupts = <50 51>;
|
||||||
gpio-controller;
|
gpio-controller;
|
||||||
|
@ -139,7 +139,7 @@
|
||||||
};
|
};
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||||||
|
|
||||||
gpio2: gpio@53f88000 {
|
gpio2: gpio@53f88000 {
|
||||||
compatible = "fsl,imx53-gpio", "fsl,imx31-gpio";
|
compatible = "fsl,imx53-gpio", "fsl,imx35-gpio";
|
||||||
reg = <0x53f88000 0x4000>;
|
reg = <0x53f88000 0x4000>;
|
||||||
interrupts = <52 53>;
|
interrupts = <52 53>;
|
||||||
gpio-controller;
|
gpio-controller;
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||||||
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@ -149,7 +149,7 @@
|
||||||
};
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};
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||||||
|
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||||||
gpio3: gpio@53f8c000 {
|
gpio3: gpio@53f8c000 {
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||||||
compatible = "fsl,imx53-gpio", "fsl,imx31-gpio";
|
compatible = "fsl,imx53-gpio", "fsl,imx35-gpio";
|
||||||
reg = <0x53f8c000 0x4000>;
|
reg = <0x53f8c000 0x4000>;
|
||||||
interrupts = <54 55>;
|
interrupts = <54 55>;
|
||||||
gpio-controller;
|
gpio-controller;
|
||||||
|
@ -159,7 +159,7 @@
|
||||||
};
|
};
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||||||
|
|
||||||
gpio4: gpio@53f90000 {
|
gpio4: gpio@53f90000 {
|
||||||
compatible = "fsl,imx53-gpio", "fsl,imx31-gpio";
|
compatible = "fsl,imx53-gpio", "fsl,imx35-gpio";
|
||||||
reg = <0x53f90000 0x4000>;
|
reg = <0x53f90000 0x4000>;
|
||||||
interrupts = <56 57>;
|
interrupts = <56 57>;
|
||||||
gpio-controller;
|
gpio-controller;
|
||||||
|
@ -197,7 +197,7 @@
|
||||||
};
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};
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||||||
|
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||||||
gpio5: gpio@53fdc000 {
|
gpio5: gpio@53fdc000 {
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||||||
compatible = "fsl,imx53-gpio", "fsl,imx31-gpio";
|
compatible = "fsl,imx53-gpio", "fsl,imx35-gpio";
|
||||||
reg = <0x53fdc000 0x4000>;
|
reg = <0x53fdc000 0x4000>;
|
||||||
interrupts = <103 104>;
|
interrupts = <103 104>;
|
||||||
gpio-controller;
|
gpio-controller;
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||||||
|
@ -207,7 +207,7 @@
|
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};
|
};
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||||||
|
|
||||||
gpio6: gpio@53fe0000 {
|
gpio6: gpio@53fe0000 {
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||||||
compatible = "fsl,imx53-gpio", "fsl,imx31-gpio";
|
compatible = "fsl,imx53-gpio", "fsl,imx35-gpio";
|
||||||
reg = <0x53fe0000 0x4000>;
|
reg = <0x53fe0000 0x4000>;
|
||||||
interrupts = <105 106>;
|
interrupts = <105 106>;
|
||||||
gpio-controller;
|
gpio-controller;
|
||||||
|
@ -217,7 +217,7 @@
|
||||||
};
|
};
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||||||
|
|
||||||
gpio7: gpio@53fe4000 {
|
gpio7: gpio@53fe4000 {
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||||||
compatible = "fsl,imx53-gpio", "fsl,imx31-gpio";
|
compatible = "fsl,imx53-gpio", "fsl,imx35-gpio";
|
||||||
reg = <0x53fe4000 0x4000>;
|
reg = <0x53fe4000 0x4000>;
|
||||||
interrupts = <107 108>;
|
interrupts = <107 108>;
|
||||||
gpio-controller;
|
gpio-controller;
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||||||
|
|
|
@ -260,7 +260,7 @@
|
||||||
};
|
};
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||||||
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||||||
gpio1: gpio@0209c000 {
|
gpio1: gpio@0209c000 {
|
||||||
compatible = "fsl,imx6q-gpio", "fsl,imx31-gpio";
|
compatible = "fsl,imx6q-gpio", "fsl,imx35-gpio";
|
||||||
reg = <0x0209c000 0x4000>;
|
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|
||||||
interrupts = <0 66 0x04 0 67 0x04>;
|
interrupts = <0 66 0x04 0 67 0x04>;
|
||||||
gpio-controller;
|
gpio-controller;
|
||||||
|
@ -270,7 +270,7 @@
|
||||||
};
|
};
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||||||
|
|
||||||
gpio2: gpio@020a0000 {
|
gpio2: gpio@020a0000 {
|
||||||
compatible = "fsl,imx6q-gpio", "fsl,imx31-gpio";
|
compatible = "fsl,imx6q-gpio", "fsl,imx35-gpio";
|
||||||
reg = <0x020a0000 0x4000>;
|
reg = <0x020a0000 0x4000>;
|
||||||
interrupts = <0 68 0x04 0 69 0x04>;
|
interrupts = <0 68 0x04 0 69 0x04>;
|
||||||
gpio-controller;
|
gpio-controller;
|
||||||
|
@ -280,7 +280,7 @@
|
||||||
};
|
};
|
||||||
|
|
||||||
gpio3: gpio@020a4000 {
|
gpio3: gpio@020a4000 {
|
||||||
compatible = "fsl,imx6q-gpio", "fsl,imx31-gpio";
|
compatible = "fsl,imx6q-gpio", "fsl,imx35-gpio";
|
||||||
reg = <0x020a4000 0x4000>;
|
reg = <0x020a4000 0x4000>;
|
||||||
interrupts = <0 70 0x04 0 71 0x04>;
|
interrupts = <0 70 0x04 0 71 0x04>;
|
||||||
gpio-controller;
|
gpio-controller;
|
||||||
|
@ -290,7 +290,7 @@
|
||||||
};
|
};
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||||||
|
|
||||||
gpio4: gpio@020a8000 {
|
gpio4: gpio@020a8000 {
|
||||||
compatible = "fsl,imx6q-gpio", "fsl,imx31-gpio";
|
compatible = "fsl,imx6q-gpio", "fsl,imx35-gpio";
|
||||||
reg = <0x020a8000 0x4000>;
|
reg = <0x020a8000 0x4000>;
|
||||||
interrupts = <0 72 0x04 0 73 0x04>;
|
interrupts = <0 72 0x04 0 73 0x04>;
|
||||||
gpio-controller;
|
gpio-controller;
|
||||||
|
@ -300,7 +300,7 @@
|
||||||
};
|
};
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||||||
|
|
||||||
gpio5: gpio@020ac000 {
|
gpio5: gpio@020ac000 {
|
||||||
compatible = "fsl,imx6q-gpio", "fsl,imx31-gpio";
|
compatible = "fsl,imx6q-gpio", "fsl,imx35-gpio";
|
||||||
reg = <0x020ac000 0x4000>;
|
reg = <0x020ac000 0x4000>;
|
||||||
interrupts = <0 74 0x04 0 75 0x04>;
|
interrupts = <0 74 0x04 0 75 0x04>;
|
||||||
gpio-controller;
|
gpio-controller;
|
||||||
|
@ -310,7 +310,7 @@
|
||||||
};
|
};
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||||||
|
|
||||||
gpio6: gpio@020b0000 {
|
gpio6: gpio@020b0000 {
|
||||||
compatible = "fsl,imx6q-gpio", "fsl,imx31-gpio";
|
compatible = "fsl,imx6q-gpio", "fsl,imx35-gpio";
|
||||||
reg = <0x020b0000 0x4000>;
|
reg = <0x020b0000 0x4000>;
|
||||||
interrupts = <0 76 0x04 0 77 0x04>;
|
interrupts = <0 76 0x04 0 77 0x04>;
|
||||||
gpio-controller;
|
gpio-controller;
|
||||||
|
@ -320,7 +320,7 @@
|
||||||
};
|
};
|
||||||
|
|
||||||
gpio7: gpio@020b4000 {
|
gpio7: gpio@020b4000 {
|
||||||
compatible = "fsl,imx6q-gpio", "fsl,imx31-gpio";
|
compatible = "fsl,imx6q-gpio", "fsl,imx35-gpio";
|
||||||
reg = <0x020b4000 0x4000>;
|
reg = <0x020b4000 0x4000>;
|
||||||
interrupts = <0 78 0x04 0 79 0x04>;
|
interrupts = <0 78 0x04 0 79 0x04>;
|
||||||
gpio-controller;
|
gpio-controller;
|
||||||
|
|
|
@ -90,11 +90,11 @@ static const struct resource imx25_audmux_res[] __initconst = {
|
||||||
|
|
||||||
void __init imx25_soc_init(void)
|
void __init imx25_soc_init(void)
|
||||||
{
|
{
|
||||||
/* i.mx25 has the i.mx31 type gpio */
|
/* i.mx25 has the i.mx35 type gpio */
|
||||||
mxc_register_gpio("imx31-gpio", 0, MX25_GPIO1_BASE_ADDR, SZ_16K, MX25_INT_GPIO1, 0);
|
mxc_register_gpio("imx35-gpio", 0, MX25_GPIO1_BASE_ADDR, SZ_16K, MX25_INT_GPIO1, 0);
|
||||||
mxc_register_gpio("imx31-gpio", 1, MX25_GPIO2_BASE_ADDR, SZ_16K, MX25_INT_GPIO2, 0);
|
mxc_register_gpio("imx35-gpio", 1, MX25_GPIO2_BASE_ADDR, SZ_16K, MX25_INT_GPIO2, 0);
|
||||||
mxc_register_gpio("imx31-gpio", 2, MX25_GPIO3_BASE_ADDR, SZ_16K, MX25_INT_GPIO3, 0);
|
mxc_register_gpio("imx35-gpio", 2, MX25_GPIO3_BASE_ADDR, SZ_16K, MX25_INT_GPIO3, 0);
|
||||||
mxc_register_gpio("imx31-gpio", 3, MX25_GPIO4_BASE_ADDR, SZ_16K, MX25_INT_GPIO4, 0);
|
mxc_register_gpio("imx35-gpio", 3, MX25_GPIO4_BASE_ADDR, SZ_16K, MX25_INT_GPIO4, 0);
|
||||||
|
|
||||||
pinctrl_provide_dummies();
|
pinctrl_provide_dummies();
|
||||||
/* i.mx25 has the i.mx35 type sdma */
|
/* i.mx25 has the i.mx35 type sdma */
|
||||||
|
|
|
@ -273,10 +273,9 @@ void __init imx35_soc_init(void)
|
||||||
|
|
||||||
imx3_init_l2x0();
|
imx3_init_l2x0();
|
||||||
|
|
||||||
/* i.mx35 has the i.mx31 type gpio */
|
mxc_register_gpio("imx35-gpio", 0, MX35_GPIO1_BASE_ADDR, SZ_16K, MX35_INT_GPIO1, 0);
|
||||||
mxc_register_gpio("imx31-gpio", 0, MX35_GPIO1_BASE_ADDR, SZ_16K, MX35_INT_GPIO1, 0);
|
mxc_register_gpio("imx35-gpio", 1, MX35_GPIO2_BASE_ADDR, SZ_16K, MX35_INT_GPIO2, 0);
|
||||||
mxc_register_gpio("imx31-gpio", 1, MX35_GPIO2_BASE_ADDR, SZ_16K, MX35_INT_GPIO2, 0);
|
mxc_register_gpio("imx35-gpio", 2, MX35_GPIO3_BASE_ADDR, SZ_16K, MX35_INT_GPIO3, 0);
|
||||||
mxc_register_gpio("imx31-gpio", 2, MX35_GPIO3_BASE_ADDR, SZ_16K, MX35_INT_GPIO3, 0);
|
|
||||||
|
|
||||||
pinctrl_provide_dummies();
|
pinctrl_provide_dummies();
|
||||||
if (to_version == 1) {
|
if (to_version == 1) {
|
||||||
|
|
|
@ -181,13 +181,13 @@ static const struct resource imx53_audmux_res[] __initconst = {
|
||||||
|
|
||||||
void __init imx50_soc_init(void)
|
void __init imx50_soc_init(void)
|
||||||
{
|
{
|
||||||
/* i.mx50 has the i.mx31 type gpio */
|
/* i.mx50 has the i.mx35 type gpio */
|
||||||
mxc_register_gpio("imx31-gpio", 0, MX50_GPIO1_BASE_ADDR, SZ_16K, MX50_INT_GPIO1_LOW, MX50_INT_GPIO1_HIGH);
|
mxc_register_gpio("imx35-gpio", 0, MX50_GPIO1_BASE_ADDR, SZ_16K, MX50_INT_GPIO1_LOW, MX50_INT_GPIO1_HIGH);
|
||||||
mxc_register_gpio("imx31-gpio", 1, MX50_GPIO2_BASE_ADDR, SZ_16K, MX50_INT_GPIO2_LOW, MX50_INT_GPIO2_HIGH);
|
mxc_register_gpio("imx35-gpio", 1, MX50_GPIO2_BASE_ADDR, SZ_16K, MX50_INT_GPIO2_LOW, MX50_INT_GPIO2_HIGH);
|
||||||
mxc_register_gpio("imx31-gpio", 2, MX50_GPIO3_BASE_ADDR, SZ_16K, MX50_INT_GPIO3_LOW, MX50_INT_GPIO3_HIGH);
|
mxc_register_gpio("imx35-gpio", 2, MX50_GPIO3_BASE_ADDR, SZ_16K, MX50_INT_GPIO3_LOW, MX50_INT_GPIO3_HIGH);
|
||||||
mxc_register_gpio("imx31-gpio", 3, MX50_GPIO4_BASE_ADDR, SZ_16K, MX50_INT_GPIO4_LOW, MX50_INT_GPIO4_HIGH);
|
mxc_register_gpio("imx35-gpio", 3, MX50_GPIO4_BASE_ADDR, SZ_16K, MX50_INT_GPIO4_LOW, MX50_INT_GPIO4_HIGH);
|
||||||
mxc_register_gpio("imx31-gpio", 4, MX50_GPIO5_BASE_ADDR, SZ_16K, MX50_INT_GPIO5_LOW, MX50_INT_GPIO5_HIGH);
|
mxc_register_gpio("imx35-gpio", 4, MX50_GPIO5_BASE_ADDR, SZ_16K, MX50_INT_GPIO5_LOW, MX50_INT_GPIO5_HIGH);
|
||||||
mxc_register_gpio("imx31-gpio", 5, MX50_GPIO6_BASE_ADDR, SZ_16K, MX50_INT_GPIO6_LOW, MX50_INT_GPIO6_HIGH);
|
mxc_register_gpio("imx35-gpio", 5, MX50_GPIO6_BASE_ADDR, SZ_16K, MX50_INT_GPIO6_LOW, MX50_INT_GPIO6_HIGH);
|
||||||
|
|
||||||
/* i.mx50 has the i.mx31 type audmux */
|
/* i.mx50 has the i.mx31 type audmux */
|
||||||
platform_device_register_simple("imx31-audmux", 0, imx50_audmux_res,
|
platform_device_register_simple("imx31-audmux", 0, imx50_audmux_res,
|
||||||
|
@ -196,11 +196,11 @@ void __init imx50_soc_init(void)
|
||||||
|
|
||||||
void __init imx51_soc_init(void)
|
void __init imx51_soc_init(void)
|
||||||
{
|
{
|
||||||
/* i.mx51 has the i.mx31 type gpio */
|
/* i.mx51 has the i.mx35 type gpio */
|
||||||
mxc_register_gpio("imx31-gpio", 0, MX51_GPIO1_BASE_ADDR, SZ_16K, MX51_INT_GPIO1_LOW, MX51_INT_GPIO1_HIGH);
|
mxc_register_gpio("imx35-gpio", 0, MX51_GPIO1_BASE_ADDR, SZ_16K, MX51_INT_GPIO1_LOW, MX51_INT_GPIO1_HIGH);
|
||||||
mxc_register_gpio("imx31-gpio", 1, MX51_GPIO2_BASE_ADDR, SZ_16K, MX51_INT_GPIO2_LOW, MX51_INT_GPIO2_HIGH);
|
mxc_register_gpio("imx35-gpio", 1, MX51_GPIO2_BASE_ADDR, SZ_16K, MX51_INT_GPIO2_LOW, MX51_INT_GPIO2_HIGH);
|
||||||
mxc_register_gpio("imx31-gpio", 2, MX51_GPIO3_BASE_ADDR, SZ_16K, MX51_INT_GPIO3_LOW, MX51_INT_GPIO3_HIGH);
|
mxc_register_gpio("imx35-gpio", 2, MX51_GPIO3_BASE_ADDR, SZ_16K, MX51_INT_GPIO3_LOW, MX51_INT_GPIO3_HIGH);
|
||||||
mxc_register_gpio("imx31-gpio", 3, MX51_GPIO4_BASE_ADDR, SZ_16K, MX51_INT_GPIO4_LOW, MX51_INT_GPIO4_HIGH);
|
mxc_register_gpio("imx35-gpio", 3, MX51_GPIO4_BASE_ADDR, SZ_16K, MX51_INT_GPIO4_LOW, MX51_INT_GPIO4_HIGH);
|
||||||
|
|
||||||
pinctrl_provide_dummies();
|
pinctrl_provide_dummies();
|
||||||
|
|
||||||
|
@ -218,14 +218,14 @@ void __init imx51_soc_init(void)
|
||||||
|
|
||||||
void __init imx53_soc_init(void)
|
void __init imx53_soc_init(void)
|
||||||
{
|
{
|
||||||
/* i.mx53 has the i.mx31 type gpio */
|
/* i.mx53 has the i.mx35 type gpio */
|
||||||
mxc_register_gpio("imx31-gpio", 0, MX53_GPIO1_BASE_ADDR, SZ_16K, MX53_INT_GPIO1_LOW, MX53_INT_GPIO1_HIGH);
|
mxc_register_gpio("imx35-gpio", 0, MX53_GPIO1_BASE_ADDR, SZ_16K, MX53_INT_GPIO1_LOW, MX53_INT_GPIO1_HIGH);
|
||||||
mxc_register_gpio("imx31-gpio", 1, MX53_GPIO2_BASE_ADDR, SZ_16K, MX53_INT_GPIO2_LOW, MX53_INT_GPIO2_HIGH);
|
mxc_register_gpio("imx35-gpio", 1, MX53_GPIO2_BASE_ADDR, SZ_16K, MX53_INT_GPIO2_LOW, MX53_INT_GPIO2_HIGH);
|
||||||
mxc_register_gpio("imx31-gpio", 2, MX53_GPIO3_BASE_ADDR, SZ_16K, MX53_INT_GPIO3_LOW, MX53_INT_GPIO3_HIGH);
|
mxc_register_gpio("imx35-gpio", 2, MX53_GPIO3_BASE_ADDR, SZ_16K, MX53_INT_GPIO3_LOW, MX53_INT_GPIO3_HIGH);
|
||||||
mxc_register_gpio("imx31-gpio", 3, MX53_GPIO4_BASE_ADDR, SZ_16K, MX53_INT_GPIO4_LOW, MX53_INT_GPIO4_HIGH);
|
mxc_register_gpio("imx35-gpio", 3, MX53_GPIO4_BASE_ADDR, SZ_16K, MX53_INT_GPIO4_LOW, MX53_INT_GPIO4_HIGH);
|
||||||
mxc_register_gpio("imx31-gpio", 4, MX53_GPIO5_BASE_ADDR, SZ_16K, MX53_INT_GPIO5_LOW, MX53_INT_GPIO5_HIGH);
|
mxc_register_gpio("imx35-gpio", 4, MX53_GPIO5_BASE_ADDR, SZ_16K, MX53_INT_GPIO5_LOW, MX53_INT_GPIO5_HIGH);
|
||||||
mxc_register_gpio("imx31-gpio", 5, MX53_GPIO6_BASE_ADDR, SZ_16K, MX53_INT_GPIO6_LOW, MX53_INT_GPIO6_HIGH);
|
mxc_register_gpio("imx35-gpio", 5, MX53_GPIO6_BASE_ADDR, SZ_16K, MX53_INT_GPIO6_LOW, MX53_INT_GPIO6_HIGH);
|
||||||
mxc_register_gpio("imx31-gpio", 6, MX53_GPIO7_BASE_ADDR, SZ_16K, MX53_INT_GPIO7_LOW, MX53_INT_GPIO7_HIGH);
|
mxc_register_gpio("imx35-gpio", 6, MX53_GPIO7_BASE_ADDR, SZ_16K, MX53_INT_GPIO7_LOW, MX53_INT_GPIO7_HIGH);
|
||||||
|
|
||||||
pinctrl_provide_dummies();
|
pinctrl_provide_dummies();
|
||||||
/* i.mx53 has the i.mx35 type sdma */
|
/* i.mx53 has the i.mx35 type sdma */
|
||||||
|
|
|
@ -38,7 +38,8 @@
|
||||||
enum mxc_gpio_hwtype {
|
enum mxc_gpio_hwtype {
|
||||||
IMX1_GPIO, /* runs on i.mx1 */
|
IMX1_GPIO, /* runs on i.mx1 */
|
||||||
IMX21_GPIO, /* runs on i.mx21 and i.mx27 */
|
IMX21_GPIO, /* runs on i.mx21 and i.mx27 */
|
||||||
IMX31_GPIO, /* runs on all other i.mx */
|
IMX31_GPIO, /* runs on i.mx31 */
|
||||||
|
IMX35_GPIO, /* runs on all other i.mx */
|
||||||
};
|
};
|
||||||
|
|
||||||
/* device type dependent stuff */
|
/* device type dependent stuff */
|
||||||
|
@ -50,6 +51,7 @@ struct mxc_gpio_hwdata {
|
||||||
unsigned icr2_reg;
|
unsigned icr2_reg;
|
||||||
unsigned imr_reg;
|
unsigned imr_reg;
|
||||||
unsigned isr_reg;
|
unsigned isr_reg;
|
||||||
|
int edge_sel_reg;
|
||||||
unsigned low_level;
|
unsigned low_level;
|
||||||
unsigned high_level;
|
unsigned high_level;
|
||||||
unsigned rise_edge;
|
unsigned rise_edge;
|
||||||
|
@ -74,6 +76,7 @@ static struct mxc_gpio_hwdata imx1_imx21_gpio_hwdata = {
|
||||||
.icr2_reg = 0x2c,
|
.icr2_reg = 0x2c,
|
||||||
.imr_reg = 0x30,
|
.imr_reg = 0x30,
|
||||||
.isr_reg = 0x34,
|
.isr_reg = 0x34,
|
||||||
|
.edge_sel_reg = -EINVAL,
|
||||||
.low_level = 0x03,
|
.low_level = 0x03,
|
||||||
.high_level = 0x02,
|
.high_level = 0x02,
|
||||||
.rise_edge = 0x00,
|
.rise_edge = 0x00,
|
||||||
|
@ -88,6 +91,22 @@ static struct mxc_gpio_hwdata imx31_gpio_hwdata = {
|
||||||
.icr2_reg = 0x10,
|
.icr2_reg = 0x10,
|
||||||
.imr_reg = 0x14,
|
.imr_reg = 0x14,
|
||||||
.isr_reg = 0x18,
|
.isr_reg = 0x18,
|
||||||
|
.edge_sel_reg = -EINVAL,
|
||||||
|
.low_level = 0x00,
|
||||||
|
.high_level = 0x01,
|
||||||
|
.rise_edge = 0x02,
|
||||||
|
.fall_edge = 0x03,
|
||||||
|
};
|
||||||
|
|
||||||
|
static struct mxc_gpio_hwdata imx35_gpio_hwdata = {
|
||||||
|
.dr_reg = 0x00,
|
||||||
|
.gdir_reg = 0x04,
|
||||||
|
.psr_reg = 0x08,
|
||||||
|
.icr1_reg = 0x0c,
|
||||||
|
.icr2_reg = 0x10,
|
||||||
|
.imr_reg = 0x14,
|
||||||
|
.isr_reg = 0x18,
|
||||||
|
.edge_sel_reg = 0x1c,
|
||||||
.low_level = 0x00,
|
.low_level = 0x00,
|
||||||
.high_level = 0x01,
|
.high_level = 0x01,
|
||||||
.rise_edge = 0x02,
|
.rise_edge = 0x02,
|
||||||
|
@ -104,12 +123,13 @@ static struct mxc_gpio_hwdata *mxc_gpio_hwdata;
|
||||||
#define GPIO_ICR2 (mxc_gpio_hwdata->icr2_reg)
|
#define GPIO_ICR2 (mxc_gpio_hwdata->icr2_reg)
|
||||||
#define GPIO_IMR (mxc_gpio_hwdata->imr_reg)
|
#define GPIO_IMR (mxc_gpio_hwdata->imr_reg)
|
||||||
#define GPIO_ISR (mxc_gpio_hwdata->isr_reg)
|
#define GPIO_ISR (mxc_gpio_hwdata->isr_reg)
|
||||||
|
#define GPIO_EDGE_SEL (mxc_gpio_hwdata->edge_sel_reg)
|
||||||
|
|
||||||
#define GPIO_INT_LOW_LEV (mxc_gpio_hwdata->low_level)
|
#define GPIO_INT_LOW_LEV (mxc_gpio_hwdata->low_level)
|
||||||
#define GPIO_INT_HIGH_LEV (mxc_gpio_hwdata->high_level)
|
#define GPIO_INT_HIGH_LEV (mxc_gpio_hwdata->high_level)
|
||||||
#define GPIO_INT_RISE_EDGE (mxc_gpio_hwdata->rise_edge)
|
#define GPIO_INT_RISE_EDGE (mxc_gpio_hwdata->rise_edge)
|
||||||
#define GPIO_INT_FALL_EDGE (mxc_gpio_hwdata->fall_edge)
|
#define GPIO_INT_FALL_EDGE (mxc_gpio_hwdata->fall_edge)
|
||||||
#define GPIO_INT_NONE 0x4
|
#define GPIO_INT_BOTH_EDGES 0x4
|
||||||
|
|
||||||
static struct platform_device_id mxc_gpio_devtype[] = {
|
static struct platform_device_id mxc_gpio_devtype[] = {
|
||||||
{
|
{
|
||||||
|
@ -121,6 +141,9 @@ static struct platform_device_id mxc_gpio_devtype[] = {
|
||||||
}, {
|
}, {
|
||||||
.name = "imx31-gpio",
|
.name = "imx31-gpio",
|
||||||
.driver_data = IMX31_GPIO,
|
.driver_data = IMX31_GPIO,
|
||||||
|
}, {
|
||||||
|
.name = "imx35-gpio",
|
||||||
|
.driver_data = IMX35_GPIO,
|
||||||
}, {
|
}, {
|
||||||
/* sentinel */
|
/* sentinel */
|
||||||
}
|
}
|
||||||
|
@ -130,6 +153,7 @@ static const struct of_device_id mxc_gpio_dt_ids[] = {
|
||||||
{ .compatible = "fsl,imx1-gpio", .data = &mxc_gpio_devtype[IMX1_GPIO], },
|
{ .compatible = "fsl,imx1-gpio", .data = &mxc_gpio_devtype[IMX1_GPIO], },
|
||||||
{ .compatible = "fsl,imx21-gpio", .data = &mxc_gpio_devtype[IMX21_GPIO], },
|
{ .compatible = "fsl,imx21-gpio", .data = &mxc_gpio_devtype[IMX21_GPIO], },
|
||||||
{ .compatible = "fsl,imx31-gpio", .data = &mxc_gpio_devtype[IMX31_GPIO], },
|
{ .compatible = "fsl,imx31-gpio", .data = &mxc_gpio_devtype[IMX31_GPIO], },
|
||||||
|
{ .compatible = "fsl,imx35-gpio", .data = &mxc_gpio_devtype[IMX35_GPIO], },
|
||||||
{ /* sentinel */ }
|
{ /* sentinel */ }
|
||||||
};
|
};
|
||||||
|
|
||||||
|
@ -160,15 +184,19 @@ static int gpio_set_irq_type(struct irq_data *d, u32 type)
|
||||||
edge = GPIO_INT_FALL_EDGE;
|
edge = GPIO_INT_FALL_EDGE;
|
||||||
break;
|
break;
|
||||||
case IRQ_TYPE_EDGE_BOTH:
|
case IRQ_TYPE_EDGE_BOTH:
|
||||||
val = gpio_get_value(gpio);
|
if (GPIO_EDGE_SEL >= 0) {
|
||||||
if (val) {
|
edge = GPIO_INT_BOTH_EDGES;
|
||||||
edge = GPIO_INT_LOW_LEV;
|
|
||||||
pr_debug("mxc: set GPIO %d to low trigger\n", gpio);
|
|
||||||
} else {
|
} else {
|
||||||
edge = GPIO_INT_HIGH_LEV;
|
val = gpio_get_value(gpio);
|
||||||
pr_debug("mxc: set GPIO %d to high trigger\n", gpio);
|
if (val) {
|
||||||
|
edge = GPIO_INT_LOW_LEV;
|
||||||
|
pr_debug("mxc: set GPIO %d to low trigger\n", gpio);
|
||||||
|
} else {
|
||||||
|
edge = GPIO_INT_HIGH_LEV;
|
||||||
|
pr_debug("mxc: set GPIO %d to high trigger\n", gpio);
|
||||||
|
}
|
||||||
|
port->both_edges |= 1 << (gpio & 31);
|
||||||
}
|
}
|
||||||
port->both_edges |= 1 << (gpio & 31);
|
|
||||||
break;
|
break;
|
||||||
case IRQ_TYPE_LEVEL_LOW:
|
case IRQ_TYPE_LEVEL_LOW:
|
||||||
edge = GPIO_INT_LOW_LEV;
|
edge = GPIO_INT_LOW_LEV;
|
||||||
|
@ -180,10 +208,23 @@ static int gpio_set_irq_type(struct irq_data *d, u32 type)
|
||||||
return -EINVAL;
|
return -EINVAL;
|
||||||
}
|
}
|
||||||
|
|
||||||
reg += GPIO_ICR1 + ((gpio & 0x10) >> 2); /* lower or upper register */
|
if (GPIO_EDGE_SEL >= 0) {
|
||||||
bit = gpio & 0xf;
|
val = readl(port->base + GPIO_EDGE_SEL);
|
||||||
val = readl(reg) & ~(0x3 << (bit << 1));
|
if (edge == GPIO_INT_BOTH_EDGES)
|
||||||
writel(val | (edge << (bit << 1)), reg);
|
writel(val | (1 << (gpio & 0x1f)),
|
||||||
|
port->base + GPIO_EDGE_SEL);
|
||||||
|
else
|
||||||
|
writel(val & ~(1 << (gpio & 0x1f)),
|
||||||
|
port->base + GPIO_EDGE_SEL);
|
||||||
|
}
|
||||||
|
|
||||||
|
if (edge != GPIO_INT_BOTH_EDGES) {
|
||||||
|
reg += GPIO_ICR1 + ((gpio & 0x10) >> 2); /* lower or upper register */
|
||||||
|
bit = gpio & 0xf;
|
||||||
|
val = readl(reg) & ~(0x3 << (bit << 1));
|
||||||
|
writel(val | (edge << (bit << 1)), reg);
|
||||||
|
}
|
||||||
|
|
||||||
writel(1 << (gpio & 0x1f), port->base + GPIO_ISR);
|
writel(1 << (gpio & 0x1f), port->base + GPIO_ISR);
|
||||||
|
|
||||||
return 0;
|
return 0;
|
||||||
|
@ -338,7 +379,9 @@ static void __devinit mxc_gpio_get_hw(struct platform_device *pdev)
|
||||||
return;
|
return;
|
||||||
}
|
}
|
||||||
|
|
||||||
if (hwtype == IMX31_GPIO)
|
if (hwtype == IMX35_GPIO)
|
||||||
|
mxc_gpio_hwdata = &imx35_gpio_hwdata;
|
||||||
|
else if (hwtype == IMX31_GPIO)
|
||||||
mxc_gpio_hwdata = &imx31_gpio_hwdata;
|
mxc_gpio_hwdata = &imx31_gpio_hwdata;
|
||||||
else
|
else
|
||||||
mxc_gpio_hwdata = &imx1_imx21_gpio_hwdata;
|
mxc_gpio_hwdata = &imx1_imx21_gpio_hwdata;
|
||||||
|
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